Page 11 - Construyendo un equipo de computo 2022

Arquitectura de Harvard

Este modelo, que utilizan los Microcontroladores PIC, tiene la unidad central
de proceso (CPU) conectada a dos memorias (una con las instrucciones y otra con
los datos) por medio de dos buses diferentes.

Una de las memorias contiene solamente las instrucciones del programa (Memoria
de Programa), y la otra sólo almacena datos (Memoria de Datos).

Ambos buses son totalmente independientes lo que permite que la CPU pueda
acceder de forma independiente y simultánea a la memoria de datos y a la de
instrucciones. Como los buses son independientes estos pueden tener distintos
contenidos en la misma dirección y también distinta longitud.
También la longitud de los datos y las instrucciones puede ser distinta, lo que
optimiza el uso de la memoria en general.

SEGMENTADAS

Las arquitecturas segmentadas o con segmentación del cauce, buscan mejorar e
desempeño realizando paralelamente varias etapas del ciclo de instrucción al
mismo tiempo. El procesador se divide en varias unidades funcionales
independientes y se dividen entre ellas el procesamiento de las instrucciones. Otra
aportación frecuente que aumenta el rendimiento del computador es el fomento del
paralelismo implícito, que consiste en la segmentación del procesador (pipe-line),
descomponiéndolo en etapas para poder procesar una instrucción diferente en cada
una de ellas y trabajar con varias a la vez.

Generalidades

• Un ciclo de instrucción (también llamado ciclo de fetch-and-execute o ciclo
de fetch-decode-execute en inglés) es el período que tarda la unidad central
de proceso (CPU) en ejecutar una instrucción de lenguaje máquina.

• Comprende una secuencia de acciones determinada que debe llevar a cabo
la CPU para ejecutar cada instrucción en un programa.

• Cada instrucción del juego de instrucciones de una CPU puede requerir
diferente número de ciclos de instrucción para su ejecución.

Un ciclo de instrucción está formado por uno o más ciclos máquina.